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sábado 12 de outubro de 2013, por admin

Estudos de algoritmos e de arquitetura

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Design flow
Design flow

Em uma fase inicial do projeto, ACEN estuda e define os algoritmos que respondem melhor ao standard, requerimentos e limitações do sistema. Esta atividade é feito em colaboração com o responsável do projeto e o equipe encarregada do desenvolvimento do hardware e software. A exploração arquitetônica permite de identificar os processadores (HW, SW) implantados na plataforma. Os algoritmos são refinados para adequar-se com seus processadores alvos. No final desta fase:

  • os processadores (FPGA, DSP, CPU) são escolhidos,
  • o mapeamento algoritmo/processador é feito,
  • as especificações gerais são liberadas.

Desenvolvimento do Gateware

Na base de especificação geral, ACEN encarrega-se do desenvolvimento do Gateware. Esta atividade é realizada nos locais da ACEN. Apesar de terceirizada, esta atividade fica sob o controle do líder do projeto através:

  • da revisão da especificação detalhada,
  • dos relatórios de design periódicos e das reuniões de progresso.

Uma grande importância é dada para testar o que funciona em simultâneo com o design gateware. Uma metodologia suplementar de teste é usada baseada em:

  • o desenvolvimento de bancos de ensaio para módulos VHDL,
  • o ensaio individual de módulos com um simulador,
  • o desenvolvimento de bancos de ensaio para subsistemas (jogo de módulos VHDL para uma parte identificada do algoritmo),
  • o teste dos subsistemas de um quadro de avaliação com o alvo FPGA.

No final da fase de design, the gateware é integralmente testado no FPGA com bancos de ensaio que simulam tão longe quanto possível o ambiente dentro do qual o FPGA funciona. Esta aproximação permite iniciar a fase de integração com um número mínimo de bugs no FPGA e também reduzir a duração das próximas fases.

Integração e verificação

A integração do FPGA com o resto da plataforma é realizada normalmente sob a responsabilidade do líder do projeto. ACEN contribui nesta integração para garantir que o FPGA está em conformidade com a especificação. O processo de verificação garante que a implementação é correta e conforme áos requerimentos listados na especificação.

Parcerias

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Design flow EDA
Design flow EDA

As partes do processo de design que não são cobertas por ACEN podem ser desenvolvidaspelos parceiros da Electronic Design Alliance:

  • seleção de componentes (outros que FPGA),
  • design de harware (quadro),
  • desenvolvimento de software,
  • integração e verificação completa.

Como resultado nesta parceria, ACEN pode encarregar-se do desenvolvimento end-to-end de um protótipo turn-key em adequação com a especificação dos clientes.

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